ADM1031
PWM_OUT
2 SECS
2 SECS
2 SECS
FULL SPEED
TACH/AIN
INT
3RD TACH
FAILURE
4TH TACH
FAILURE
STATUS REG READ TO
CLEAR INTERRUPT
5TH TACH
FAILURE
CONTINUING
TACH FAILURE
FAN_FAULT
Figure 38. Operation of FAN_FAULT and Interrupt Pins
5.0 V
5.0 V MAX
(DO NOT CONNECT
TO 12 V)
5.0 V
FAN2
2 ? WIRE
FAN
10 kV
TYP
TACH
FAN1 1
3 ? WIRE
FAN
3 .3 V
3 .3 V 3 .3 V
2.2 kV 2.2 kV
SCL
NDT3055L
(N ? MOS)
R SENSE
NDT3055L
(NMOS)
0.01mF
THERM
SIGNAL TO
THROTTLE
CPU CLOCK
3 .3 V
10 kV
TYP
3 .3 V
10 kV
TYP
3 .3 V
10 kV
TYP PWM_OUT1
TACH1/AIN1
PWM_OUT2
TACH2/AIN2
GND
3.3 V
V CC
THERM
FAN_FAULT
1
2
3
4
5
6
7
8
ADM1031
16
15
14
13
12
11
10
9
SCL
SDA
INT (SMBALERT)
ADD
D2+
D2–
D1+
D1–/NTI
3 .3 V
10 kV
TYP
SDA
CPU INTERRUPT
2N3904 OR PENTIUM III
CPU THERMAL DIODE
2N3904 OR PENTIUM III
CPU THERMAL DIODE
FAN_FAULT
TO SIGNAL
FAN FAILURE
CONDITION
10 kV
TYP
1 IN ACTUAL APPLICATION, BOTH FANS MUST BE 2 ? WIRE OR 3 ? WIRE TYPE. A SINGLE BIT
CONTROLS WHETHER TACH1/AIN1 AND TACH2/AIN2 ARE ANALOG OR DIGITAL INPUTS.
Figure 39. Typical Application Circuit
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